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题名:
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综合与时序分析的设计约束 zong he yu shi xu fen xi de she ji yue shu / (美)斯里达尔·甘加达兰(Sridhar Gangadharan), (印)桑杰·丘里瓦拉(Sanjay Churiwala)著 , 韩德强, 张丽艳, 王宗侠等译 |
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ISBN:
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978-7-111-58894-8 价格： CNY59.00 |
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语种:
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chi |
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载体形态:
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15,174页 图 24cm |
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出版发行:
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出版地： 北京 出版社： 机械工业出版社 出版日期： 2018 |
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内容提要:
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本书内容包括受时序约束的关键环节的设计流程、综合时序分析、静态时序分析和布局布线等。首先详细讲解时序要求的概念，然后详细解释如何将其应用于设计流程中的特定阶段，最后通过实践介绍在Synopsys约束设计下（SDC）业界领先约束的格式。 |
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主题词:
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集成电路 电路设计 |
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中图分类法:
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TN402 版次： 5 |
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其它题名:
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Synopsys设计约束(SDC)实用指南 |
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主要责任者:
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甘加达兰 gan jia da lan 著 |
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主要责任者:
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丘里瓦拉 qiu li wa la 著 |
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次要责任者:
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韩德强 han de qiang 译 |
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次要责任者:
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张丽艳 zhang li yan 译 |
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次要责任者:
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王宗侠 wang zong xia 译 |
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责任者附注:
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斯里达尔·甘加达兰，毕业于印度卡哈拉格普尔理工学院的电子工程师，拥有20年的EDA和VLSI经验。目前就职于Xilinx公司海得拉巴办事处。 |
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责任者附注:
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桑杰·丘里瓦拉，Artenta公司的时序约束分析和SpyGlass PTL分析产品的高级产品工程总监。 |
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责任者附注:
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韩德强，北京工业大学信息学部计算机学院实验中心主任，高级工程师。 |
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索书号:
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TN402/4704 |